黑龙江
一份新的路线泄露，揭开了 AMD 远期 APU 产品线 Grimlock 的面纱。
作为 Zen7 架构的主力融合处理器，它在核显、内存总线规格上做了明显分层，高端型号的内存带宽相比当下 Strix Halo 直接翻倍，为本地 AI 负载预留了充足性能空间。
APU处理器迭代规划
先理清 AMD 移动端 APU 的迭代节奏。
当前在售锐龙 APU，采用 Zen5 加 RDNA 3.5 的组合。 这条产品线会在 2026 至 2028 年，由 Zen6+RDNA5 方案承接换代。
但产品线内部并非全部升级新核显，定位中低端的 Medusa Point，依旧沿用 RDNA 4m 架构 GPU，配备 8 组 CU，搭配 128bit 位宽 LPDDR5X 内存。
到 2029 年，Zen7 架构的 Grimlock 系列正式登场，产品周期将持续至 2031 年。
和很多人预想的不同，Zen7 这一代的核显并不会全部上新架构，而是延续分级策略：
核显主体为 RDNA5 架构，在原有基础上持续优化，同时保留成熟的 RDNA4m 方案覆盖入门档位。
Grimlock 系列一共划分三个层级，定位差异清晰。
中低端型号为 Grimlock 2，方案相对保守，维持 RDNA 4m GPU + 128bit LPDDR5X 内存的组合，主打续航、轻薄本和入门整机市场，控制成本。
RDNA5核显要增强？
高端 Grimlock 1 系列，升级为 RDNA5 AT4 级别核显，拥有 24 组 WGP，合计 48 个 CU 单元，内存总线升级至 192bit LPDDR6。
旗舰型号 Grimlock Halo，是这套路线里规格最强的一档。搭载 RDNA5 AT3 核显，48 组 WGP，总计 96 个 CU 单元，内存总线直接给到 384bit LPDDR6。内存频率区间覆盖 10667MT/s 至 14400MT/s，换算下来内存带宽可以达到 512GB/s 到 691GB/s。
作为对比，现在 Zen5 架构的 Strix Halo，内存带宽仅 256GB/s 至 273GB/s。
Zen6、Zen7 两代平台，带宽实现至少翻倍。旗舰档位上限 691GB/s，已经接近 RTX 4080 独立显卡的带宽水平。
近几年轻量化小参数模型持续迭代优化，对带宽、显存容量的需求持续走高。一旦硬件就位，轻薄本、迷你主机这类小尺寸设备，有望实现稳定的本地推理。
这套规格组合带来的想象空间，集中在本地 AI 领域。如果后续可以搭配 256GB 大容量内存，再配上 96CU 核显与接近高端独显的内存带宽，对本地大模型运行十分友好。
写代码、长文本对话、多轮连续任务都可以脱离云端 API，不再受调用额度和接口成本限制，真正做到本地 Token 自由。
当然，高规格也面向传统负载。更强的核显配合超大带宽，游戏、视频渲染、本地转码性能都会同步受益。AI 与图形两条路线，都会吃到这次规格升级的红利。
需要说明，以上全部信息来自网络路线泄露，尚未经过 AMD 官方确认。
架构代号、CU 数量、内存位宽、发布时间与周期，都存在后续调整的可能性。
但从 Zen5、Zen6 再到 Zen7 的 APU 迭代脉络可以看出，AMD 正在持续拉大高端融合处理器的规格上限，不再只是满足轻度办公和网游。
大容量统一内存、超高带宽、大 CU 规模核显，共同指向同一个方向：把本地 AI 能力下放至移动平台，让轻薄设备具备过去独立显卡才能拥有的推理能力。
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